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Achat du CV JobGate n° Job11766 - CV Ingénieur en électronique

TITRE DU CV (principal) : Ingénieur CNAM en électronique numérique

Intitulé de la qualification : Ingénieur en électronique

 

Numéro : 11766
Date d'inscription : 07/05/2007
Date de dernière connexion : 03/01/2008
Dernière modification : 03/01/2008
Date de disponibilité : immédiate

CV WORD principal Disponible

Statut :
ingénieur Mobilité / région de recherche : France entière
Niveau du diplome :
bac + 5 Contrat recherché : CDI
Années d'experiences :
10 ans et plus Habite le département - ville : 33 - Bordeaux
   
langue1 :    Anglais                niveau : moyen
langue2 :    Italien                niveau : scolaire
 
Experience

 PARCOURS PROFESSIONNEL

Depuis 12/07 Consultant Hardware chez MBDA via CSIE – Bourges


Ingénieur en électronique : Consultant Hardware en électronique.
Modification de documentation, industrialisation d'un missile ASMPA.
Environnement
Electronique Analogique et numérique, Mécanique, Optique, analyse de problème sur des systèmes complexe.


De 09/2007 à 11/07 Consultant Hardware chez Thales Avioniques via CSIE – Bordeaux

Conception, simulation du code VHDL pour la carte de calcul radar pour le Rafale. Carte basée sur un FPGA Altera Stratix II GX associé à un bus PCI, 5 voie de transmission rapide 6,5Gb/s, une voie de sérialisation d'un flux vidéo sur 3x7 bits, association à une mémoire QDRII.

Ingénieur en électronique : Consultant Hardware en électronique numérique FPGA.
Configuration des transcivers Altéra (partie réception).
Conception, simulation du code VHDL de la partie réception transciever. Dé encapsulation des données séries à la norme sFPDP fibre optique en flot de donnée parallèle.
Conception, simulation du code VHDL de la partie émission de code PRBS (occuper les transcievers en mode test).
Conception, simulation du code VHDL de la partie voie codeur Hotlik. Multiplexage des données parallèle vers les voie de codages.
Conception, simulation du code VHDL de la partie transmission BVB. Encapsulation des données parallèles selon le protocole BVB (CRC, + protocole) puis sérialisation des données 21 bits en 3x7bits.
Conception, simulation du code VHDL de la partie espion. Espionner les flots internes 32 bits en mode test.
Simulation de la partie PCI. Envoie des données de la QDRII sur un transciever en émission, bouclage sur un autre transciever en réception, décodage du protocole et envoie des données vers le bus PCI.

Environnement
Electronique numérique, Altéra, Quartus, modelsim, analyse de problème sur des systèmes complexe.


Depuis septembre 2007 Consultant Hardware chez CSIE – Bordeaux


Ingénieur en électronique : Consultant Hardware en électronique numérique FPGA.
Développer des circuits spécifiques complexes, ciblant les technologies de type FPGA.
Assurer la conception, la simulation, puis l'intégration sur les cartes cibles.
Développer le logiciel associé.

Environnement
Electronique Analogique et numérique, Mécanique, Optique, analyse de problème sur des systèmes complexe.


De (09/2006) à (07/2007) reprise de mon poste de technicien à SAGEM DS – Dijon


Ingénieur en électronique : Expert sur les systèmes électronique de visée.
Evolution du poste fin 2002 vers une spécialisation à l'intégration et l'industrialisation des nouvelles productions de viseurs gyrostabilisés. Passage du premier prototype à la phase d’industrialisation ; conception des outils de production et mise en place des procédures.

Environnement
Electronique Analogique et numérique, Mécanique, Optique, analyse de problème sur des systèmes complexe.


De (09/2005) à (07/2006) chez Laboratoire LE2I, Laboratoire d'Electronique, Informatique et Image – Dijon

Mise en place d'une application de traitement d'image sur une carte de prototypage rapide Xilinx ML310

Mise en place d'une application de traitement d'image sur une carte de prototypage rapide Xilinx ML310. Implantation d'un noyau de compression JPEG matériel dans le FPGA Virtex II pro XC2VP30 de la carte ML310. Mise en place d'un noyau Linux sur cette carte. L'application est pilotée via un serveur Web. Depuis un navigateur Internet installé sur une machine PC déportée, l'utilisateur visualise un flux vidéo compressé matériellement par le FPGA à la norme JPEG. Le flux vidéo provient d'une Webcam connectée sur la carte ML310.

Partie HARD :
_ Adaptation/modification de la description VHDL du core JPEG au FPGA Xilinx Virtex-II-Pro.
_ Réécriture (VHDL) du fichier de simulation, Simulation puis synthèse du core JPEG adapté.
_ Conception de l’interface VHDL entre le core JPEG adapté et le bus IBM CoreConnect. Simulation de cette interface.
_ Intégration de l’interface et du composant JPEG à la carte ML310.

Partie Soft :
Installation des outils de développement pour linux :
Sous une distribution Mandraque (Montavista).
Sous Windows par l’intermédiaire de Cygwin. Modification et installation d’un compilateur croisé C (Crosstool).
_ Modification/Compilation du noyau linux Montavista embarqué sur la carte ML310. Intégration du driver pour le composant JPEG, Intégration d’un driver pour la WebCam, options de partage de fichiers (Samba,NTFS,NFS).
_ Modification/Compilation de la distribution Montavista embarquée sur la carte ML310. Installation de gcc, serveur Web (Apache), de librairies…
Environnement technique :
Développement FPGA, Co-Design, cycle en V. Encadré par des enseignants chercheurs
Environnement
C, VHDL, Verilog, Développement FPGA Xilinx Virtex II Pro, Co-Design, cycle en V, Processeur cible Power PC405, Noyau Linux embarqué temps réel,. Encadré par des enseignants chercheurs

De 10/2000 à 09/2005 chez SAGEM DS – Dijon


Technicien en électronique : Expert réparation électronique système de visée.
Evolution du poste fin 2002 vers une spécialisation à l'intégration et l'industrialisation des nouvelles productions de viseurs gyrostabilisés. Passage du premier prototype à la phase d’industrialisation ; conception des outils de production et mise en place des procédures.

CDI comme technicien à la société SAGEM Défense Sécurité à Dijon pour le réglage et la réparation de viseurs optroniques, sur chars et hélicoptères
Environnement
Electronique Analogique et numérique, Mécanique, Optique, analyse de problème sur des systèmes complexe.
De (12/1997) à (09/2000) chez PARVEX – Dijon


Technicien SAV en électronique (machine outils, ensemble moteur variateur commande numérique) : Intervention client, Formation client, dépannage sur site, rétrofit
Réparation des variateurs de vitesse et des commandes numériques sur le site de Dijon et en clientèle

Installation des produits en clientèle. Formation du client. Définition de produits pour le rétrofit ou la mise à jour.
Environnement
Intervention chez un grand nombre de clients dans un grand nombre de domaines (CEA, Médical, Michelin, GIAT, Métallurgie…) aussi bien pour des machines de grandes séries ou de production unitaires.

De (04/1996) à (08/1996) chez CEA Valduc – Dijon


Stage pour le DUT d’informatique : Rénovation d'un programme d'essais d'accident de criticité avec acquisition et traitement des mesures. Double compétence électronique/informatique
Définition des besoins de la nouvelle application.

Conception du nouveau programme d’acquisition (capteurs neutronique sur liaison IEEE et capteur limnimètrique série) et d’exploitation des mesures.
Environnement
Encadré par des enseignants chercheurs, ingénieurs CEA

 
Formation

 Formations
Septembre 2005 - Juillet 2006 : Diplôme d'ingénieur CNAM en électronique mention TB CNAM Dijon.

Septembre 1999 - Avril 2002 : Diplôme d'Enseignement Supérieur Technique en Electronique (Maîtrise) CNAM Dijon.

Septembre 1995 - Août 1996 : DUT d'Informatique option Informatique et Génie Logiciel à l’IUT de Dijon.

Septembre 1993 - Juin 1995 : BTS d'Electronique mention AB au lycée Gustave Eiffel à Dijon.

Septembre 1992 - Juin 1993 : Bac F2 (électronique) mention AB au lycée Gustave Eiffel à Dijon.

 
Divers

 L’EXCELLENT Fabien


Ingénieur CNAM en électronique
Spécialisation en conception, prototypage FPGA


COMPETENCES METIER / DOMINANTES TECHNIQUES

Compétences métier
:
Conception, prototypage FPGA Xilinx
Adaptation IP matérielles VHDL sur les FPGA Xilinx.
FPGA altera Stratix II GX, IP PCI Megacore, CRC, CRCchk, transciever.
Technicien en électronique analogique/numérique (9 ans) : Formation client,
Industrialisation, Production, SAV.

Dominantes techniques
:
FPGA Xilinx (Spartan, Virtex, Virtex II, Virtex II Pro)
Environnement de développement Xilinx ISE EDK, Altera Quartus
Programmation VHDL Verilog
Logiciels de conception FPGA : Simulation Modelsim, Synthèse Synplify
Logiciel : Dos Windows (3.11 à XP), Programmation sous linux C, Compilation de noyau Linux Temps Réel, Installation de distribution Linux embarqué sur une carte de prototypage.
Electronique analogique.
Electronique numérique


ETUDES ET FORMATIONS

Septembre 2005 – décembre 2006 : Diplôme d'ingénieur CNAM en électronique mention Très Bien CNAM Dijon.

Septembre 1999 - Avril 2002 : Diplôme d'Enseignement Supérieur Technique en Electronique (Maîtrise) CNAM Dijon.

Septembre 1995 - Août 1996 : DUT d'Informatique option Informatique et Génie Logiciel à l’IUT de Dijon.

Septembre 1993 - Juin 1995 : BTS d'Electronique mention AB au lycée Gustave Eiffel à Dijon.

Septembre 1992 - Juin 1993 : Bac F2 (électronique) mention AB au lycée Gustave Eiffel à Dijon.


Formation
:
Habilitation électrique BC 12/2007 APAVE Bourges
EN 9100 – 2 jours en 2007
ISO 9001 – 2 jours en 2004
Méthode de résolution de problème COMET CORUM 4 jours en 2004.
Méthode 5S, Kaizen


COMPETENCES TECHNIQUES


Langages
:
Langages objets : C++ (notions)

Langages et Assembleurs : VHDL, Verilog, ADA, C, Assembleur X86 PowerPC 68000 68HC11 Z80 Pic

Autres Langages : HTML, Script TCL, Perl, CGI
Systèmes
:
Dos, Windows 3.11 à XP, Linux (distributions RedHat, Mandrake, Mandriva), Linux sous Windows Cygwin.

OS temps réel
:
Montavista Linux

IHM
:
CLI Unix, Command.com pour les Windows basés sur MS-DOS, et cmd.exe pour les Windows NT, Eplorer Windows, Tool Command Language (Tcl/Tk), bash , sh , csh
Cibles numériques
:
Logique Programmable : FPGA Xilinx (Spartan, Virtex, Virtex2, Virtex-2-Pro, Virtex4)
FPGA Altera Stratix II GX
Microprocesseurs, DSP : PowerPC 405

Microcontrôleurs : 68HC11, PICs, Z80
Elec. analogique
:
Convertisseurs, alimentations, filtrage, amplification, commande de moteurs CC et Brushless, Codeur optique résolveur tachymètre, Gyrostabilisation
Méthodes de Conception
:
Merise, cycle en V, Co-design
Protocoles réseaux
:
TCP/IP, PPP, Token Ring, Ethernet, IP, TCP, UDP, FTP, http, NFS, protocole Samba ou SMB/CIFS, Telnet

Outils et matériels
:
Emulateur et debugger PowerPC 405, Analyseur logique, oscilloscope, OnoSokky
Xilinx (ISE EDK), Altera Quartus, Modelsim, Synplify, Mathlab (notions), PSPICE (notions), Labview (notions)

Bus, Protocoles et Interfaces
:
Bus d'instrumentation IEEE 488, CAN Bus, I2C, Interface série RS232 RS422, USB
Equipements Réseaux
:
Ethernet, Switch, Routeur, Wifi
Logiciels
:
Word, Excel, PowerPoint, Lotus Notes, Corel Draw, Adobe PDF (distiler)
Langues
:
Anglais professionnel 60/100 au test Bulat en 2004
Italien scolaire

PARCOURS PROFESSIONNEL

Depuis 12/07 Consultant Hardware chez MBDA via CSIE – Bourges


Ingénieur en électronique : Consultant Hardware en électronique.
Modification de documentation, industrialisation d'un missile ASMPA.
Environnement
Electronique Analogique et numérique, Mécanique, Optique, analyse de problème sur des systèmes complexe.


De 09/2007 à 11/07 Consultant Hardware chez Thales Avioniques via CSIE – Bordeaux

Conception, simulation du code VHDL pour la carte de calcul radar pour le Rafale. Carte basée sur un FPGA Altera Stratix II GX associé à un bus PCI, 5 voie de transmission rapide 6,5Gb/s, une voie de sérialisation d'un flux vidéo sur 3x7 bits, association à une mémoire QDRII.

Ingénieur en électronique : Consultant Hardware en électronique numérique FPGA.
Configuration des transcivers Altéra (partie réception).
Conception, simulation du code VHDL de la partie réception transciever. Dé encapsulation des données séries à la norme sFPDP fibre optique en flot de donnée parallèle.
Conception, simulation du code VHDL de la partie émission de code PRBS (occuper les transcievers en mode test).
Conception, simulation du code VHDL de la partie voie codeur Hotlik. Multiplexage des données parallèle vers les voie de codages.
Conception, simulation du code VHDL de la partie transmission BVB. Encapsulation des données parallèles selon le protocole BVB (CRC, + protocole) puis sérialisation des données 21 bits en 3x7bits.
Conception, simulation du code VHDL de la partie espion. Espionner les flots internes 32 bits en mode test.
Simulation de la partie PCI. Envoie des données de la QDRII sur un transciever en émission, bouclage sur un autre transciever en réception, décodage du protocole et envoie des données vers le bus PCI.

Environnement
Electronique numérique, Altéra, Quartus, modelsim, analyse de problème sur des systèmes complexe.


Depuis septembre 2007 Consultant Hardware chez CSIE – Bordeaux


Ingénieur en électronique : Consultant Hardware en électronique numérique FPGA.
Développer des circuits spécifiques complexes, ciblant les technologies de type FPGA.
Assurer la conception, la simulation, puis l'intégration sur les cartes cibles.
Développer le logiciel associé.

Environnement
Electronique Analogique et numérique, Mécanique, Optique, analyse de problème sur des systèmes complexe.


De (09/2006) à (07/2007) reprise de mon poste de technicien à SAGEM DS – Dijon


Ingénieur en électronique : Expert sur les systèmes électronique de visée.
Evolution du poste fin 2002 vers une spécialisation à l'intégration et l'industrialisation des nouvelles productions de viseurs gyrostabilisés. Passage du premier prototype à la phase d’industrialisation ; conception des outils de production et mise en place des procédures.

Environnement
Electronique Analogique et numérique, Mécanique, Optique, analyse de problème sur des systèmes complexe.


De (09/2005) à (07/2006) chez Laboratoire LE2I, Laboratoire d'Electronique, Informatique et Image – Dijon

Mise en place d'une application de traitement d'image sur une carte de prototypage rapide Xilinx ML310

Mise en place d'une application de traitement d'image sur une carte de prototypage rapide Xilinx ML310. Implantation d'un noyau de compression JPEG matériel dans le FPGA Virtex II pro XC2VP30 de la carte ML310. Mise en place d'un noyau Linux sur cette carte. L'application est pilotée via un serveur Web. Depuis un navigateur Internet installé sur une machine PC déportée, l'utilisateur visualise un flux vidéo compressé matériellement par le FPGA à la norme JPEG. Le flux vidéo provient d'une Webcam connectée sur la carte ML310.

Partie HARD :
_ Adaptation/modification de la description VHDL du core JPEG au FPGA Xilinx Virtex-II-Pro.
_ Réécriture (VHDL) du fichier de simulation, Simulation puis synthèse du core JPEG adapté.
_ Conception de l’interface VHDL entre le core JPEG adapté et le bus IBM CoreConnect. Simulation de cette interface.
_ Intégration de l’interface et du composant JPEG à la carte ML310.

Partie Soft :
Installation des outils de développement pour linux :
Sous une distribution Mandraque (Montavista).
Sous Windows par l’intermédiaire de Cygwin. Modification et installation d’un compilateur croisé C (Crosstool).
_ Modification/Compilation du noyau linux Montavista embarqué sur la carte ML310. Intégration du driver pour le composant JPEG, Intégration d’un driver pour la WebCam, options de partage de fichiers (Samba,NTFS,NFS).
_ Modification/Compilation de la distribution Montavista embarquée sur la carte ML310. Installation de gcc, serveur Web (Apache), de librairies…
Environnement technique :
Développement FPGA, Co-Design, cycle en V. Encadré par des enseignants chercheurs
Environnement
C, VHDL, Verilog, Développement FPGA Xilinx Virtex II Pro, Co-Design, cycle en V, Processeur cible Power PC405, Noyau Linux embarqué temps réel,. Encadré par des enseignants chercheurs

De 10/2000 à 09/2005 chez SAGEM DS – Dijon


Technicien en électronique : Expert réparation électronique système de visée.
Evolution du poste fin 2002 vers une spécialisation à l'intégration et l'industrialisation des nouvelles productions de viseurs gyrostabilisés. Passage du premier prototype à la phase d’industrialisation ; conception des outils de production et mise en place des procédures.

CDI comme technicien à la société SAGEM Défense Sécurité à Dijon pour le réglage et la réparation de viseurs optroniques, sur chars et hélicoptères
Environnement
Electronique Analogique et numérique, Mécanique, Optique, analyse de problème sur des systèmes complexe.
De (12/1997) à (09/2000) chez PARVEX – Dijon


Technicien SAV en électronique (machine outils, ensemble moteur variateur commande numérique) : Intervention client, Formation client, dépannage sur site, rétrofit
Réparation des variateurs de vitesse et des commandes numériques sur le site de Dijon et en clientèle

Installation des produits en clientèle. Formation du client. Définition de produits pour le rétrofit ou la mise à jour.
Environnement
Intervention chez un grand nombre de clients dans un grand nombre de domaines (CEA, Médical, Michelin, GIAT, Métallurgie…) aussi bien pour des machines de grandes séries ou de production unitaires.

De (04/1996) à (08/1996) chez CEA Valduc – Dijon


Stage pour le DUT d’informatique : Rénovation d'un programme d'essais d'accident de criticité avec acquisition et traitement des mesures. Double compétence électronique/informatique
Définition des besoins de la nouvelle application.

Conception du nouveau programme d’acquisition (capteurs neutronique sur liaison IEEE et capteur limnimètrique série) et d’exploitation des mesures.
Environnement
Encadré par des enseignants chercheurs, ingénieurs CEA



 
Premier poste recherché
titre du poste :
Ingénieur en électronique numérique FPGA/Linux
CV associé :
CV WORD poste recherché n°1 disponible
Categorie :
Electronique / Electrotechnique
Poste :
Ingénieur en Electronique / Ingénieur Electronicien
Deuxieme poste recherché
titre du poste :
CV associé :
Aucun
Categorie :
Poste :
Troisieme poste recherché
titre du poste :
CV associé :
Aucun
Categorie :
Poste :
 
Pack 1 CV - avec coordonnées
Montant HT : 100 €
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Montant TTC :  59,80 €
   
 
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